SoC 互联IP使高度可扩展的神经网络系统具有集成的硬件功能安全特性，符合ISO 26262 ASIL D 的规范。
Apr. 18, 2017, Apr. 18, 2017 –
在刚刚过去的Linley Autonomous Hardware Conference 2017大会上，硅验证商用系统级芯片互联 IP 的创新供应商ArterisIP 宣布推出 Ncore 2.0 缓存一致性 (Cache Coherent) 互连 IP 及可选配的Ncore Resilience 套件，用于加速和完善下一代自动驾驶系统和高级驾驶辅助系统 (ADAS) 的设计开发。
Ncore 是一款分布式异构缓存一致性互连IP(distributed heterogeneous cache coherent interconnect IP)，能助力 SoC 设计团队透过嵌入式低延迟Proxy Caches（也称作"I/O 高速缓存"）轻松集成自定义处理单元。在神经网络机器学习 SoC 中，工作负载通常被划分到不同的处理单元上，低延迟Proxy Caches提供更高效的利用软硬件方式在所有不同的单元间通信，性能明显优于固定式内部 SRAM 或暂存器内存。这些类型的架构是自动驾驶系统的核心。